Xilinx-IP-core之RAM用法指南.doc
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1、XILINX Ipcore 之RAM用法指南一 RAM分类XILINX的RAM可分为三种,分别是:单口RAM,简化双口RAM和真双口RAM。如下图所示:图.1 单口RAM 图.2 简化双口RAM A口写入数据,B口读数据 图.3 真双口RAM A,B任意一个口都可以读写数据,可从A写入,B读数据二 选择数据位宽和深度Block RAM的数据位宽为1-1152bit,深度取决于所选择FPGA器件中block的数量。超出地址范围之外的写操作,写进去的数据不会与存储器件中的数据冲突。读超出地址范围之外数据将会返回无效数据。注意,当对超出范围的地址进行操作的时候,不能置位set或reset信号,因为这
2、仍然会读出无效数据。三 操作模式每个端口的操作模式决定了此端口的读和写之间关系。端口A和B可以独立配置为以下三种模式中任一模式:写优先模式,读优先模式,不改变模式。这些模式详解见下面。当A和B端口地址有冲突时,操作模式就会影响A和B口之间关系。1 写优先模式(write first mode):在写优先模式中,输入数据被自动写入存储器件中,并且出现在数据输出端口。时序见下图。这种传输模式增强了在同一端口写操作时使用数据输出总线的灵活性。 图.4 写优先操作模式2 读优先模式(read first mode):在读优先模式中,预先存储在写地址中的数据会被输出,而输入数据被存入存储器件中。这种模式
3、见下图。 图.5 读优先模式3 不改变模式:在不改变模式中,输出锁存在写操作时候保持不变,见下图。在同一端口的写操作不会对数据输出端口产生影响,输出仍然是以前的读数据。图.6 不改变模式四 数据位宽比例Block RAM产生器支持端口A和B的位宽不同。即DINA,DINB,DOUA,DOUTB位宽可以互不相同。支持1:32到32:1之间的比例,端口A的宽度最大可达端口B的32倍,反之亦然。 例如一个A口位宽32bit深度2048的真双口RAM,如果B端口宽度为8bit深度为8192。那么A地址总线位宽为11bits,B地址总线位宽为13bits。数据存在little-endian中,见下图。A
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