移位寄存器.pptx
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1、1移位寄存器移位寄存器74164A、B:串行数据输入端:串行数据输入端Cr:异步清零端:异步清零端CP:时钟端:时钟端274164时序图3双向移位寄存器双向移位寄存器T41944双向移位寄存器双向移位寄存器T4194功能功能S0=F0=S1 S0 Q0+S1 S0 DSR+S1 S0 Q1+S1 S0 D0电路由四个电路由四个RS触发器、四个触发器、四个4-1MUX和一些门电路组成。和一些门电路组成。DIL:左移输入:左移输入 DIR:右移输入:右移输入S1S0:功能选择:功能选择 Cr:清零:清零 CP:时钟,上升沿触发:时钟,上升沿触发D0D1D2D3:并行输入:并行输入 Q0Q1Q2Q3
2、:并行输出:并行输出Q0:左移位输出:左移位输出 Q3:右移位输出:右移位输出S1=F1=S1 S0 Q1+S1 S0 Q0+S1 S0 Q2+S1 S0 D1S2=F2=S1 S0 Q2+S1 S0 Q1+S1 S0 Q3+S1 S0 D2S3=F3=S1 S0 Q3+S1 S0 Q2+S1 S0 DSL+S1 S0 D3根据电路可列出四个触发器输入根据电路可列出四个触发器输入S的表达式如下:的表达式如下:5双向移位寄存器双向移位寄存器T4194功能表:功能表:输入输入 输出输出 时时钟钟 复复位位 控制控制 串入串入 并入并入 CP Cr S1S0 DSL DSR D0D1D2D3 Q0Q
3、1Q2Q3 功能功能 X 0 X X X X X X X X 0 0 0 0 清零清零 1 1 1 X X D0D1D2D3 D0D1D2D3 置数置数 1 1 0 D X X X X X Q1Q2Q3 D 左移左移 1 0 1 X D X X X X D Q0Q1Q2 右移右移 1 0 0 X X X X X X Q0Q1Q2Q3 保持保持 6集成异步二进制计数器集成异步二进制计数器74293逻辑电路逻辑电路74293功能:功能:R1、R2:复位信号,:复位信号,R1和和R2同时为同时为“1”时输出被清零。时输出被清零。Q0 是是 1bit 计数器;计数器;Q3Q2Q1 是是 3bit 计数
4、器;计数器;如果把如果把CP1接接Q0,则,则Q3Q2Q1Q0组成组成 4bit 二进制计数器。二进制计数器。符号:符号:7可预置数的集成异步二进制计数器可预置数的集成异步二进制计数器74177功能:功能:Rd:复位信号;:复位信号;C/L:置数:置数/计数信号;计数信号;DCBA:置数输入;:置数输入;QdQcQbQa:计数输出:计数输出CP1,CP2:时钟端:时钟端电路电路符号符号8 集成异步十进制计数器集成异步十进制计数器7490以以CP0为计数脉冲,为计数脉冲,Q0为输出,得到一位二进制计数器;以为输出,得到一位二进制计数器;以CP1为计数为计数脉冲,脉冲,Q3Q2Q1为输出,得到为输
5、出,得到5进制计数器,计数状态为(进制计数器,计数状态为(Q3Q2Q1):):000 001 010 011 100,Q3为为CP1的的5分频输出;分频输出;R1、R2:清零端;:清零端;S1、S2:置:置9 端;把端;把CP1与与Q0接在一起,以接在一起,以CP0为计数脉冲,为计数脉冲,Q3Q2Q1Q0为为输出,则为输出,则为8421BCD码十进制计数器;把码十进制计数器;把CP0与与Q3接在一起,以接在一起,以CP0为为计数脉冲,计数脉冲,Q3Q2Q1Q0为输出,则为为输出,则为8421BCD码十进制计数器。码十进制计数器。97490的两种接法的两种接法CP1与Q1相连构成8421BCD码
6、CP0与Q3相连构成5421BCD码10可预置数的集成异步十进制计数器可预置数的集成异步十进制计数器7417674176是是7490的功能扩展。各信号功能与的功能扩展。各信号功能与74177相同。相同。11 集成同步二进制加计数器集成同步二进制加计数器74161Q3 Q2Q1 Q0:计数输出C:进位输出LD:置数信号(同步)D3 D2D1 D0:置数输入Rd:异步复位信号S1S2:功能选择信号CP:计数脉冲输入端符号:功能表:(74160功能表与此相同)1274161时序图时序图LDCPC11001100101101111111000010000100清零置数计数保持S1S0Q0Q1Q2Q3D
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