EDA课设报告自动打铃器.doc
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1、燕 山 大 学EDA课程设计报告书题目: 自动打铃器 姓名: 班级: 电子信息工程4班 学号: 成绩: (注:此文件应以同学学号为文件名)一、设计题目及要求题目:自动打铃器要求:1有数字钟功能;(不包括校时等功能)2可设置六个时间,定时打铃;3响铃5秒钟。二、设计过程及内容1、总体设计思路(1)使电路有计时功能,分别利用两个十进制74160设置成六十进制和二十四进制计数器。用已经设计完成的两个六十进制和一个二十四进制计数器进位连接完成时,分,秒的计数功能(2)用三个74160设置成366进制的计数器,并将这个366进制的计数器设置成分频器得到1hz的时钟脉冲作为开始的输入信号。(3)四个八选一
2、数字选择器和7449译码器设计成电路完成数字显示功能,用一个八进制计数器控制实验箱上的八个数码管。(4)连接有计数功能的模块的相应输出端设置六个时间,通过与门和非门,连接到响铃模块的输入端以控制其响铃。全天计数器的输出端与扫描显示电路输入端对应连接。(5)一个D触发器和一个五进制计数器做成响铃五秒的响铃电路。最后将以上设计的五个模块连接起来,组成自动打铃器。2、设计过程该自动打铃器由五部分构成,分别为分频电路、数字钟电路、扫描显示电路、设定时间电路、响铃电路。第一部分 分频电路分频电路是为了对732Hz脉冲进行分频,得到1Hz的脉冲信号。该模块由三片74160芯片级联构成732进制计数器,采用
3、整体置0法。输出频率为1Hz的信号,为数字钟提供脉冲。电路图如下图1 分频电路电路图对分频电路进行仿真,所得仿真波形如图2:图2 分频电路仿真波形第二部分 数字钟电路该部分电路是用来设定全天二十四小时的计数器,由时、分、秒三个模块连接而成。三个模块均由两片74160芯片级联构成,都是采用整体置0法。分、秒模块是六十进制计数器,时模块为二十四进制计数器。几个电路图及仿真波形图如下:图3 秒模块60进制计数器图4 秒模块60进制计数器仿真波形图5 分模块60进制计数器图6 分模块60进制计数器仿真波形图7 时模块24进制计数器图8 时模块24进制计数器仿真波形三个模块串行连接,秒模块的输出接到分模
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