数电部分复习题2011.4.doc
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1、个人收集整理 勿做商业用途注:以下为部分复习题,“分析设计题”请认真做课后的习题及实验.个别复习题有重复,望谅解。个别题可能还会有争议,请同学们讨论。没讲的不用复习。一、填空题 l 在数字电路中,常用的计数制除十进制外,还有( )、( )、( ).l ( 5E。C)16=( )2=( )8=( )10= ( )8421BCDl 若1100是2421BCD码的一组代码,则它对应的十进制数是_l 逻辑代数又称为 ( )代数。最基本的逻辑关系有( )、( ) 、( )三种.常用的几种导出的逻辑运算为( )、( ) 、( )、( ) 、( ).l 逻辑代数的三个重要规则是( ) 、( ) 、( ) .
2、l 格雷码的特点是相邻两个码组之间有( )位码元不同。l 逻辑函数F=+B+D的反函数= ( ) 。l 逻辑函数F=A(B+C)1的对偶函数是( )。l 用五级D触发器组成的扭环计数器有( )个有效状态.l 要使JK触发器异步置1,则应使( )为高电平,( )为低电平。l J-K触发器在CP脉冲作用下,欲使Qn+1=0,则必须使_A. J=0 K=0 B。 J=0 K=1C。 J=1 K=0 D。 J=1 K=1l 按正逻辑体制,与下列真值表相对应的逻辑门应是_A。 与门 B. 或门 C. 异或门 D. 与非门输入 A B输出 F输入 A B输出 F0 011 010 111 10l 若110
3、1是2421BCD码的一组代码,则它对应的十进制数是( )。l 在组合逻辑电路中,若其输出函数表达式满足F=A+/A或F=( )就可能出现冒险现象。 l 欲将二进制代完全没看过码翻译成输出信号选用( ),欲将输入信号编成二进制代码选用( ),欲将数字系统中多条传输线上的不同数字信号按需要选择一个送到公共数据线上选用( ),欲实现两个相同位二进制数和低位进位数的相加运算选用( )。a编码器; b译码器; c多路选择器; d数值比较器;e加法器; f触发器; 计数器; h寄存器l TTL与非门存在拉电流负载特性和灌电流负载特性,输出高电平时的负载特性为( )电流负载特性。l 集电极开路门英文缩写为
4、( )门,工作时必须外加( )和( )l 、OC门称为 门,多个OC门输出端并联到一起可实现 功能。l 、TTL与非门电压传输特性曲线分为 区、 区、 区、 区。l 一个基本RS触发器在正常工作时,不允许输入R=S=1的信号,因此它的约束条件是 。l 在一个CP脉冲作用下,引起触发器两次或多次翻转的现象称为触发器的 ,触发方式为 式或 式的触发器不会出现这种现象。触发器有 个稳态,存储8位二进制信息要 个触发器。l 、一个基本RS触发器在正常工作时,它的约束条件是+=1,则它不允许输入= 且= 的信号。l 、触发器有两个互补的输出端Q、,定义触发器的1状态为 ,0状态为 ,可见触发器的状态指的
5、是 端的状态。l 、半导体数码显示器的内部接法有两种形式:共 接法和共 接法。l 、消除竟争冒险的方法有 、 、 等。l 、由四位移位寄存器构成的顺序脉冲发生器可产生 个顺序脉冲。l 、时序逻辑电路按照其触发器是否有统一的时钟控制分为 时序电路和 时序电路。l 1三态与非门的三种状态是指( )态、( )态、( )态。l 欲设计一个二十四进制计数器,至少需要( )个触发器。l 国产TTL电路( )相当于国际SN54/74LS系列,其中LS表示( )。l 在函数F =AB +C的真值表中,F =1的状态有( )个?l 如图所示电路中,若脉冲C的频率为f,则F2输出端Q2波形的频率为( )。l 如上
6、图所示电路中,若脉冲C的频率为f,则F1输出端Q1波形的频率为_。二、判断题 l 当8421奇校验码在传送十进制数10时,在校验位上出现了1时,表明在传送过程中出现了错误。( )l 传送十进制数5时,在8421奇校验码的校验位上值应为1。( l 数字电路中用“1”和“0分别表示两种状态,二者无大小之分.( )l 在时间和幅度上都断续变化的信号是数字信号,语音信号不是数字信号.( )l 逻辑变量的取值,比大。( ).l 异或函数与同或函数在逻辑上互为反函数。( )。l 若两个函数具有相同的真值表,则两个逻辑函数必然相等。( )。l 若两个函数具有不同的真值表,则两个逻辑函数必然不相等.( )l
7、若两个函数具有不同的逻辑函数式,则两个逻辑函数必然不相等。( )l 逻辑函数两次求反则还原,逻辑函数的对偶式再作对偶变换也还原为它本身。( )l TTL与非门的多余输入端可以接固定高电平。( )l 当TTL与非门的输入端悬空时相当于输入为逻辑1.( )l TTL与非门的多余输入端可以接固定高电平。( )l 普通的逻辑门电路的输出端不可以并联在一起,否则可能会损坏器件.( )l CMOS或非门与TTL或非门的逻辑功能完全相同。( )l 三态门的三种状态分别为:高电平、低电平、不高不低的电压。( )l TTL集电极开路门输出为时由外接电源和电阻提供输出电流.( )l 一般TTL门电路的输出端可以直
8、接相连,实现线与.( )l D触发器的特性方程为Qn+1=D,与Qn无关,所以它没有记忆功能。( )l S触发器的约束条件RS=0表示不允许出现R=S=1的输入。( )l 同步触发器存在空翻现象,而边沿触发器和主从触发器克服了空翻。( )l 主从JK触发器、边沿JK触发器和同步JK触发器的逻辑功能完全相同。( )l 两个TTL或非门构成的基本RS触发器,当R=S=0时,触发器的状态为不定。l 边沿JK触发器,在CP为高电平期间,当J=K=1时,状态会翻转一次。( )l 优先编码器的编码信号是相互排斥的,不允许多个编码信号同时有效。( )l 编码与译码是互逆的过程.( )l 数据选择器和数据分配
9、器的功能正好相反,互为逆过程.( )l 数据选择器可实现时序逻辑电路.( )l 组合逻辑电路中产生竞争冒险的主要原因是输入信号受到尖峰干扰.( )l 时序电路由组合电路和存储器两部分组成。( )l 时序电路不含有记忆功能的器件。( )l 组合电路不含有记忆功能的器件。( )l 同步时序电路具有统一的时钟CP控制。( )l 异步时序电路的各级触发器类型不同。( )l 计数器的模是指构成计数器的触发器的个数.( )l D触发器的特征方程Qn+1=D,而与Qn无关,所以,D触发器不是时序电路。( )l 在同步时序电路的设计中,若最简状态表中的状态数为2N,而又是用N级触发器来实现其电路,则不需检查电
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