数字电路课程设计-数字电子钟.doc
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1、数字电路课程设计-数字电子钟 作者: 日期:2 个人收集整理 勿做商业用途辽 宁 工 业 大 学 数字电子技术基础 课程设计(论文)题目: 数字电子钟 院(系): 电子与信息工程学院 专业班级: 电子092 学 号: 090404031 学生姓名: 罗哲 指导教师: 关维国 (签字)起止时间: 2011。12。12-2011。12.23 课程设计(论文)任务及评语院(系):电子与信息工程学院 教研室:电子信息工程学号090404031学生姓名罗哲专业班级电子092课程设计题目数字电子钟课程设计(论文)任务设计参数:(1)能直接显示时、分、秒十进制数字(2)具有校时功能。(3)具有整点报时功能。
2、(4)采用中、小规模数字集成电路实现。(5)利用EWB进行计算机仿真。设计要求:1 。分析设计要求,明确性能指标.必须仔细分析课题要求、性能、指标及应用环境等,广开思路,构思出各种总体方案,绘制结构框图.2 。确定合理的总体方案.对各种方案进行比较,以电路的先进性、结构的繁简、成本的高低及制作的难易等方面作综合比较,并考虑器件的来源,敲定可行方案。3 .设计各单元电路。总体方案化整为零,分解成若干子系统或单元电路,逐个设计。4.组成系统。在一定幅面的图纸上合理布局,通常是按信号的流向,采用左进右出的规律摆放各电路,并标出必要的说明。进度计划1、布置任务,查阅资料,理解掌握数字电子钟的设计要求.
3、(1天)2、确定数字电子钟技术指标,设计方案框图.(2天)3、设计各中间级电路的电路图.(2天)4、绘制整体电路图,确定其工作原理.(2天)5、对系统进行仿真,完成整体电路图并性能分析.(2天)6、撰写、打印设计说明书(1天)指导教师评语及成绩平时: 论文质量: 答辩: 学生签字: 总成绩: 指导教师签字: 年 月 日摘要实现电子钟的方法有很多,如用单片机或纯数字电路实现。本文主要讲述电子钟的纯数字电路设计,即不包含软件部分。而单纯的硬件电路对于初学者掌握最基本的电学原理是有着重要作用的。本文主要包含脉冲发生电路设计、计数器设计和控制电路设计三部分。产生脉冲的方式本文将介绍三种,这三种方法各有
4、千秋,有的易于实现,有的稳定性能很好。脉冲发生在这个设计中主要有两个作用,一个是作为时基信号,另一个是在整点报时的时候驱动扬声器发生。在计数器部分,本文采用了异步计数的方式,并阐述了不使用同步法计数的主要原因。实现数字电子钟需要使用六片4位二级制计数器分别组成十进制,六进制,和二十四进制的计数器。数字电子钟的校对功能同样重要,本文给出了通过手动开关和数字(电路)控制开关来实现校对功能的方法。即对计数器而言,既可以通过改变时钟信号来校准,也可以通过读取预置数来校准。本文也包含了显示电路单元的设计,以及实物的制作等内容.本文最终的实现方案可行性将在第五章中详加叙述。同时将说明在设计方面存在的不足以
5、及改进的方法。- 5 -目录第1章 绪论1第2章 脉冲发生电路的设计22.1 方案一:555定时器外接RC元件构成多谐振荡电路22.2 方案二:用CD4060外接晶振的振荡电路22.3 方案三:用双三极管组成的振荡电路3第3章 计数器设计53。1 异步电路实现方法53。2 同步电路实现方法7第4章 控制电路设计94。1 校准功能的实现94.2 LED显示电路104。3 整点报时功能的实现11第5章 实际电路的制作和调试125.1 秒脉冲和分脉冲模块125。2 时、分计数及显示模块135.3 电源和扬声器模块13第6章 课程设计总结14参考文献15附录1 整体电路图16附录2 器件清单1716第
6、1章 绪论实现电子钟的方法有很多,如用单片机或纯数字电路实现。本文主要讲述电子钟的纯数字电路设计,即不包含软件部分。虽然在软件与硬件的界限逐渐不甚清晰的今天,纯硬件电路的应用已愈来愈少,但单纯的硬件电路对于初学者掌握最基本的电学原理仍有重要作用.也可以说,搞好硬件电路的设计与开发,是软件编程的基础.本文主要分三部分来阐述数字电子钟的设计.即时钟发生器的设计,计数器设计和控制电路的设计。其中,时钟发生器的原理较为简单,本文介绍了三种实现方法,分别是“555定时器外接RC元件构成多谐振荡电路”、“用CD4060外接晶振的振荡电路、“用双三极管组成的振荡电路”。后者较为复杂。主要体现在各片计数器之间
7、的关系上。由于同步法实现起来有诸多问题,所以第三章本文将主要介绍异步的实现方法。第四章的控制电路的设计主要通过74161芯片读取预置数的功能来实现。设计数字电子钟,计数器是核心环节,主要通过计数器芯片和与非门电路等互相搭配来实现。第三章和第四章的介绍仅限于理论的分析,对其实际操作的环节将在第五章中着重介绍。其重点在于是同步控制还是异步控制,是利用读数清零,还是令其强制清零.同时,由于可以实现的计数器有很多.但不同的芯片其功能有不尽形同,在设计的时候,要求设计者要能区分这其中细微的差别。第2章 脉冲发生电路的设计2.1 方案一:555定时器外接RC元件构成多谐振荡电路555定时器是一种常见的时钟
8、发生电路。它具有电路结构简单,使用的外围元件少等特点.由555定时器构成的多谐振荡器由电阻R1、R2,电容C以及旁路电容Cp等组成。其输出频率:当f=1Hz时,若选C为1F的电解电容,取ln2=0.69,得R1+2R2=1449。275k。令R1=1M,R2=449.275k。若R2用220k+220k+6.8k+10k/3.3k的形式替换,可得到周期为1。00000403s的脉冲。图21 555多谐振荡电路2.2 方案二:用CD4060外接晶振的振荡电路本电路主要由14位二进制串行计数器CD4060和JK触发器CD4027组成.14位二进制计数器CD4060内部含有一个由非门电路组成的振荡器
9、,在CD4060的10、11脚之间接上一个32.768kHz的晶体,就可以构成一个振荡器,其输出脉冲经过施密特整形电路整形后送入内部进行计数、分频,经214=16384分频,在输出端可得到2Hz()的标准信号.再经一级CD4027组成的2分频电路分频,即可得到秒脉冲信号。图2-2 用晶振产生恒定脉冲电路电路中C2为微调电容,用来调整晶振的振荡频率.2.3 方案三:用双三极管组成的振荡电路电路原理图如下图所示,其中Q1与C1为一组,Q2与C2为一组.当前者充电时,当前者充电时,Q1截止,Q1集电极输出高电平(此时Q2处于导通状态);当C1负极电压上升至Q1的导通电压后,Q1导通,Q1集电极输出低
10、电平,同时C2负极瞬间失电,Q2截止。C2负极在开始充电,直到Q2再次导通。此电路的周期的理论值为图23 双三极管组成的振荡电路图24 双三极管组成的振荡电路波形图图24对电路进行了仿真测试。蓝色波形为Q2集电极波形,黑色为C1电容器的负极波形.有图中可看出,C1从负电压开始充电,当到达Q1导通电压时(Q1导通电压约为0.7V),Q2集电极输出高电平。图2-5 上升延迟时间此电路原理较为简单,但起振的条件受RC值的影响较大。如当R1和R4小于1K时电路即不可振荡,若其值稍大,则电容器正极板充电较慢,表现为没有明显的上升沿。(如图)由于受限条件较多,所以也很难得出较为精确的1s脉冲,故不采用此方
11、案.第3章 计数器设计3.1 异步电路实现方法计数器由6片十六进制计数器74HC161(或用十进制计数器74160亦可)和其他门电路构成。分别用于模拟电子钟的时、分、秒的个位和十位。如下图所示,将脉冲信号送入第一片的CLK端,作为时钟。7脚(ENP)、1脚(CLR)、10脚(ENT)均接Vcc。这里需要注意的是如果使用TTL集成电路,且电源电压大于5.5V,以上需接高电平的各引脚不能与电源直接相连,否则会使IC损坏.而如果使用CMOS集成电路,则多余输入端一定不能悬空,因为电平不稳会对电路的逻辑情况产生干扰。图31 分钟信号产生方法第一片正常工作时,由于时钟频率为1Hz,所以每过1s计数一次,
12、也就相当于电子钟秒的个位数,其工作状态应为10进制计数器。由于74161是16进制计数器,所以在Q1A和Q1D后接与非门反馈到置数端(LD),即当输出为1001时得到下降沿读数。之所以不使用复位法清零,是因为复位清零功能不受时钟控制。如果使用复位法清零,应将与非门接在Q1B和Q1D之后再反馈到清零端,这样就可以在输出“1010”(8421码的A)的时刻立即清零。由于不受时钟控制,所以不必等到时钟下降沿到来,清零过程只是一个瞬间,在数显管上也不会显示出来.但此种方法形成的脉冲占空比接近于1,在对下一片作用的时候有效脉冲宽度有限,所以不采用复位法清零。 0 1 2 3 4 5 6 7 8 9 0
13、1 2 3 4 5 6 7 8 9 (a) (b)图32 复位清零(a)与置数清零(b)的比较以第一片的清零信号作为第二片的时钟信号。 第二片相当于电子钟秒的十位,其工作状态应设置为6进制计数器。当其计数到“0101”(BCD码的5)时,维持一个由第一片分频所得的脉冲周期,即等待个位再计数10次,然后通过读取预置数清零。 图33 秒清零信号与十秒清零信号波形 使用双通道示波器的不同量程对这部分电路进行跟踪,其波形如图33。图中幅值量程大的是第二片的清零信号,幅值小的是第一片的清零信号,即第二片的时钟信号。从图中可明显看出,当第一片的清零信号(即第二片的时钟信号)下降沿到来时,读取预置数,将Q2
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