后摩尔时代的新集成与新材料.pdf
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1、行业顾问商业尽调募投研究专家网络2022年8月后摩尔时代的新集成与新材料后摩尔时代的新集成与新材料行业分享框架行业分享框架2后摩尔时代后摩尔时代,半导体行业聚焦:半导体行业聚焦:12新材料新材料SiC新集成新集成Chiplet后摩尔时代,后摩尔时代,Chiplet模式有望延续模式有望延续摩尔定律的“经济效益”摩尔定律的“经济效益”SiC材料具备性能和应用优势,材料具备性能和应用优势,成为成为后摩尔时代的新宠儿后摩尔时代的新宠儿摩尔定律使单个芯片上集成的晶体管数量从几千个增加到十几亿个,是过去半导体、计算机行业发展的决定摩尔定律使单个芯片上集成的晶体管数量从几千个增加到十几亿个,是过去半导体、计
2、算机行业发展的决定性规律,但摩尔定律逐渐遭遇瓶颈性规律,但摩尔定律逐渐遭遇瓶颈3资料来源:DIGITIMES,灼识咨询芯片迭代对比芯片迭代对比芯片面积芯片面积()3nm125.0016nm10nm7nm5nm晶管数量晶管数量(亿)(亿)净净晶圓可切晶圓可切割晶片數割晶片數晶圆造价晶圆造价($)87.6683.2785.0085.00334369105141359.74512.44545.65530.25509.04晶粒造价晶粒造价($)5,9128,3899,96512,50015,50016.4316.3718.2623.5730.75单位面积中晶体管数量的几何级增长,对芯片的成本也会呈几何
3、级数增长单位面积中晶体管数量的几何级增长,对芯片的成本也会呈几何级数增长10nm7nm5nm3nm2nm0.520.951.271.70.530.971.732.94.91.061.835.2SAMSUNG(三星)(三星)TSMC(台积电)(台积电)Intel(英特尔)(英特尔)IBM头部厂商晶体管密度估算对比,头部厂商晶体管密度估算对比,2021百万/平方毫米受制于芯片尺受制于芯片尺寸的物理极限寸的物理极限1受制于光刻技受制于光刻技术术2受制于隧道效受制于隧道效应应3受制于功耗和受制于功耗和散热问题散热问题4受制于供电和受制于供电和信号处理能力信号处理能力有限有限53.3326个月36个月未
4、达到摩尔定律*根据摩尔定律,芯片上集成的晶体管数目大约每经过18个月便会增加一倍后摩尔时代,后摩尔时代,Chiplet由于其高性能、低功耗、高面积使用率以及低成本受到广泛关注,在延续摩尔定律的由于其高性能、低功耗、高面积使用率以及低成本受到广泛关注,在延续摩尔定律的“经济效益”方面被寄予厚望“经济效益”方面被寄予厚望4资料来源:灼识咨询SoC Vs.ChipletDORDORDORDORDORDORDORI/OI/OI/OI/OI/OI/OI/OI/OFour“Zen”Cores+L3Four“Zen”Cores+L3Four“Zen”Cores+L3Four“Zen”Cores+L3DORF
5、our“Zen”Cores+L3Four“Zen”Cores+L3Four“Zen”Cores+L3Four“Zen”Cores+L3DORDORI/OI/OFour“Zen”Cores+L3Four“Zen”Cores+L3DORDORI/OI/OFour“Zen”Cores+L3Four“Zen”Cores+L3DORDORI/OI/OFour“Zen”Cores+L3Four“Zen”Cores+L3DORDORI/OI/OFour“Zen”Cores+L3Four“Zen”Cores+L3SoC芯片芯片 以AMD 32-core 芯片为例 总面积7772 造价1.0X*Chiplet芯
6、片芯片 以AMD 4*8-core Chiplet为例 每个Chiplet面积为213 2,总面积8522 造价0.59X*可提供较大的性能功耗优化空间,支持面向特定领域的灵活定制 有效提升信号传输质量和带宽 利用小芯片(具有相对低的面积开销)低工艺和高良率可以获得有效降低成本开销 可以有效缩短芯片的研发周期及节省研发投入,并降低研制风险模模组组化化模块器器件件数数量量t功功能能密密度度t摩尔定律功能密度曲线2D-3D,面积,面积-体积,体积,Chiplet有望从另一个维度延续摩尔定律的“经济效益”有望从另一个维度延续摩尔定律的“经济效益”所有器件都可以在一个硅片上集成,器件数量将以指数方式增
7、长器件将以多种方式集成,系统空间内的功能密度将持续增长Chiplet灵活的“模块化”设计思维,将使得未来灵活的“模块化”设计思维,将使得未来IP硬核芯片化,提供了新的产品模式,芯片产业链格局将随硬核芯片化,提供了新的产品模式,芯片产业链格局将随之发生变化之发生变化5资料来源:灼识咨询IP硬核芯片化硬核芯片化IP产品模式更新产品模式更新产业链格局改变产业链格局改变Chiplet是新的硅片级硅片级IP重用模式重用模式Chiplet在工艺选择、架构设计上在工艺选择、架构设计上都具有灵活性都具有灵活性,优化了IP硬核无法修改导致的复用困难和使用范围较窄的问题半导体半导体IP授授权商权商芯片制造和封芯片
8、制造和封装厂商装厂商Chiplet供供应商应商Chiplet芯片制芯片制造和封装厂商造和封装厂商新进入芯片设计厂商新进入芯片设计厂商升级升级扩大生产线扩大生产线帮助帮助进入进入委托委托芯片行业半导体IP授权商升级为Chiplet供应商,进一步扩大扩大IP价值价值Chiplet供应商可以帮助互联网厂商等缺乏芯帮助互联网厂商等缺乏芯片设计经验和资源的企业发展芯片产品片设计经验和资源的企业发展芯片产品IP软核软核IP固核固核IP硬核硬核 寄存器代码 行为级验证 逻辑描述 网表 帮助文档 布局布线 布局规划 硬件参数 物理版图 掩模版图 系统工艺EDA设计FPGA设计Chiplet 包含定义明确的功能
9、子集的微型集成电路“小芯片”基板基板转接层转接层IP1IP2IP3IP4IP芯片化芯片化基板基板转接层转接层GPUVPUNPUISP不同功能的不同功能的Chiplets传统单片系统设计方式是从不同的从不同的IP供应供应商处购买商处购买IP,结合自研模块集成,结合自研模块集成Chiplet模式下只需要购买供应商生产好的Chiplet小芯片,将其封装形成系统芯片将其封装形成系统芯片即可Chiplet 已在已在FPGA、CPU、GPU、数据中心等领域表现出其独特的优势,市场空间不断提升、数据中心等领域表现出其独特的优势,市场空间不断提升6资料来源:Omedia,灼识咨询市场需求市场需求Chiplet
10、的应用的应用尽管Chiplet的标准化才刚刚起步,但它已在高性能CPU,FPGA等领域表现出独特优势,未来市场空间巨大;Chiplet吸引英特尔和AMD等国际芯片厂商投入相关研发,在当前在当前SoC遭遇工艺节点遭遇工艺节点和成本瓶颈的情况下有望发展成为一种和成本瓶颈的情况下有望发展成为一种新的芯片生态新的芯片生态6.59.812.018.527.540.058.084.02024E20202018201920212022E2023E2025ECAGR 41.7%CAGR 46.0%亿美元Chiplet市场规模,全球,市场规模,全球,2018-2025EFPGACPU数据中心GPUChiplet
11、模式落地必须实现异构芯片的集成,其中涉及两个难点:异构芯片之间的互连、集成性能的优化,先模式落地必须实现异构芯片的集成,其中涉及两个难点:异构芯片之间的互连、集成性能的优化,先进封装技术是后者的关键进封装技术是后者的关键7资料来源:灼识咨询Chiplet异构集成示意图异构集成示意图 Chiplet模式把一些实现特定功能的芯片裸片集成为一个系统芯片,提升系统芯提升系统芯片可扩展性和灵活性片可扩展性和灵活性 对采用不同工艺的裸片进行封装对采用不同工艺的裸片进行封装,如上图所示,对高性能CPU采用最新工艺,而一般功能模块降低工艺需求GPU 5nm Chiplet主存 22nm ChipletISP
12、12nm ChipletCPU 5nm ChipletI/O 22nm ChipletVPU 12nm ChipletChiplet异构集成难点异构集成难点Chiplet异构集成解决方案异构集成解决方案先进封装提升异构集成性能先进封装提升异构集成性能缺乏高效统一的互连接口和协议缺乏高效统一的互连接口和协议行业解决方案行业解决方案12异构集成性能挑战异构集成性能挑战 EMIB(嵌入式多芯片互联桥)使用硅桥中介,实现异构芯片集成互连 硅桥成本低、结构散热性好芯片1芯片2EMIB芯片带宽不一致导芯片带宽不一致导致信号传输不稳定致信号传输不稳定Chiplet之间的互连不直接,功耗需要平衡功耗需要平衡芯
13、片的堆叠让散热散热问题变得更加棘手问题变得更加棘手不同厂商生产的小不同厂商生产的小芯片成为孤岛芯片成为孤岛高速接口高速接口需高数据吞吐量、低数据延迟、低误码率各厂商推出高速互连协议,如Intel的AIB协议、NVIDIA的NVLink协议Intel等行业巨头成立Chiplet标准联盟,制制定通用定通用Chiplet的高速的高速互连标准互连标准UCIe测试是一个挑战测试是一个挑战,要保证系统芯片能正常工作先进封装是实现先进封装是实现Chiplet的方式,目前行业内主要的先进封装工艺有倒装封装、晶圆级封装、的方式,目前行业内主要的先进封装工艺有倒装封装、晶圆级封装、2.5D/3D封装以封装以及及S
14、iP系统级封装等,尤其后三者是行业焦点系统级封装等,尤其后三者是行业焦点8资料来源:灼识咨询倒倒装装封封装装晶晶圆圆级级封封装装2.5D/3D封封装装3D封装封装2.5D封装封装 2.5D/3D封装是三维层面三维层面的多芯片堆叠多芯片堆叠封装工艺,其将多个芯片进行堆叠封装,需使用TSV硅穿孔技术,对贴片机精度要求在2.5-3m 其中2.5D封装技术是将不同芯片通过中介层中介层将不同芯片进行电路连接,电路连接效率更高,速度更快;而3D封装技术是直接实现硅片或者芯片之间的多层堆叠扇入型扇入型晶片正面朝下RDL层PCB锡球扇出型扇出型环氧树脂 晶圆级芯片封装技术(Wafer Level Packag
15、ing)是对整片晶圆进行封装测试整片晶圆进行封装测试后再切割得到单个成品芯片的技术,封装后的芯片尺寸与裸片一致。其中扇入型利用RDL层层将电信号向内向内扩展至芯片中心;扇出型则将电信号向外向外扩展至芯片外的区域,因此后者可连接更多引脚 去除基板,均摊成本更低均摊成本更低关键指标提升关键指标提升 先封装后切割,大幅降低封测后的大幅降低封测后的IC尺寸尺寸 晶圆形式批量处理,加工效率高加工效率高 扇出型封装提高引脚数量,互联密提高引脚数量,互联密度最大化度最大化 倒装封装(Flip-Chip),是在I/O底板上沉积锡铅球,然后将芯片翻转加热,利用熔融的锡铅球与陶瓷机板相结合来替换传统的打线键合(W
16、ire Bond)除去引线,显著减小封装尺寸显著减小封装尺寸 具有更强的散热性能更强的散热性能 具有更好的电学性能更好的电学性能,可突破传统封装的频率上限 提高提高I/O引脚数量引脚数量 封装尺寸和重量显著减小尺寸和重量显著减小 多芯片集成,封装性能和带宽显著性能和带宽显著提升提升 有助于降低整体成本有助于降低整体成本主要先进封装工艺主要先进封装工艺晶片倒装晶片倒装晶片正面朝下基层PCB锡球引线系统级封装系统级封装 系统中封装(System in Package),是将多种功能芯片,包括处理器、存储器等功能芯片集成在一个封装内,从而实现一个基本完整的功能 SiP技术通过标准的片外焊线键合(Wi
17、re Bond)或焊料凸点(Flip Chip)连接芯片 SiP可以垂直堆叠或水平平铺 封装的内部结构和电气直接互连,免除其他步骤,降低成本免除其他步骤,降低成本 实现更高的集成度实现更高的集成度 可降低整体功耗整体功耗 减小减小封装体积与重量体积与重量PCB板封装载板Memory chipProcessor chip半导体半导体SiP传统引线键合传统引线键合晶片正面朝上基层PCB锡球行行业业关关注注焦焦点点先进封装技术在近十年间快速发展迭代,整体呈现出先进封装和芯片制造融合的趋势,先进封装技术在近十年间快速发展迭代,整体呈现出先进封装和芯片制造融合的趋势,台积电、台积电、IntelIntel
18、、三星、三星等业内领先玩家均以高性能封装为下一世代重点投入方向等业内领先玩家均以高性能封装为下一世代重点投入方向9资料来源:灼识咨询先进封装先进封装面世时间面世时间2D/2.5D/3D功能密度功能密度应用领域应用领域主要厂商主要厂商FOWLPCoWoSHBMHMC INFOEMIBFOPLPWide-IOFoverosCo-EMIBTSMC-SoICX-Cube2009201220152012201620182017201220182019202020202D2D2D2D2.5D3D+2.5D3D3D3D3D+2D3D3D智能手机、5G、AIiPhone、5G、AI移动设备、5G、AIGrap
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